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FPGA核心板原理图、pcb分享!51/stm8/stm32核心板也一起送了吧!

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发表于 2016-1-12 00:08:14 | 显示全部楼层 回帖奖励 |倒序浏览 |阅读模式
本帖最后由 江湖笑 于 2016-1-12 10:45 编辑

        近期在学FPGA的,于是在某宝花了200多买了个FPGA的核心板,是个4层板,做工也很精致。 点个赞
        以前一直想尝试画一个4层板,都没有去尝试。 这次终于有机会一试身手了
第一个4层板就从FPGA核心板开始吧,于是乎,花了三天时间,这几天差不多除了吃饭就是在画板子了,现在这个fpga核心板终于完工了,深夜把资料全部整理开源共享到阿莫坛子。
                                 
                                                                                          响应下本论坛的“友好交流气氛、乐于开源共享” 精神!  

由于是第一次画4层板,也是第一次画FPGA封装的,这个板子肯定存在很多问题,恳请坛内大侠们指点纠正!



坛友们如果感兴趣的话,麻烦先去顶一下贴  ,再去下载资料, 真心希望这个帖子不要沉得太快了,能让更多初涉电子行业的新手看到,让他们也能够继续将开源精神传下去。
     希望广大坛友能够顶起来,让莫老大能看到,给个“精华裤子”穿下。




FPGA核心板3D正面图  (3D封装都是我自己画的,虽然画的累,但是全部完工了,看整体3D效果图还是很舒服的


FPGA核心板3D背面图



top layer



内电层(第二层)


第三层


bottom layer


FPGA核心板原理图



FPGA_borad_原理图/pcb   
下载资料之前,麻烦先去顶一下贴 。别让沉了啊,顶起来

FPGA_borad_3D封装库

FPGA_borad_原理图PDF版




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前两年画的51单片机、stm8 、stm32单片机的最小系统pcb板 也顺便分享下!
这三块板子当时是为了方便学弟学妹们学习单片机我自己画的,当时都分别别在嘉利创打了50张样板,经后期使用没有问题的。


51单片机-最小系统原理图、pcb



STM8S003F3P6最小系统STM32最小系统



STM32最小系统STM32最小系统



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你熬了10碗粥,别人一桶水倒进去,淘走90碗,剩下10碗给你,你看似没亏,其实你那10碗已经没有之前的裹腹了,人家的一桶水换90碗,继续卖。说白了,通货膨胀就是,你的钱是挣来的,他的钱是印来的,掺和在一起,你的钱就贬值了。

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 楼主| 发表于 2016-1-12 00:32:08 | 显示全部楼层
本帖最后由 江湖笑 于 2016-1-12 00:41 编辑


不小心,帖子发出去了,我还没编辑完啊

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 楼主| 发表于 2016-1-12 10:02:41 来自手机 | 显示全部楼层
gnocy 发表于 2016-1-12 08:34
板子的分层是,top(信号)- 内电层- 信号 - 地层。这样分层好像不太好吧,请教一下,看过好像电源层都放在 ...

是的,一般电源层是放在中间两层。。考虑到我这个板子fpga256个引脚,要全部拉出来。由于我这个板子是5*7cm的,面积有点挤,底层也放了好多元器件,再加上底层有好多电容,所以底层就不方便拉IO线了。

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 楼主| 发表于 2016-1-12 10:04:44 来自手机 | 显示全部楼层
zzh4933 发表于 2016-1-12 09:46
我看黑金的pcb也是有这种分层,不知道好不好。17楼说法也有道理。

是的,我就是参考黑金的板子分层方式,这样拉线方便点

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 楼主| 发表于 2016-1-12 10:46:40 | 显示全部楼层
WM_CH 发表于 2016-1-12 10:33
调试接口需要的话都可以做出小的,JTAG好大哦。支持,顶起

不大啊,只是板子小了,看起来大,这是标准的10针JTAG接口

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 楼主| 发表于 2016-1-12 12:59:34 | 显示全部楼层
河图洛书 发表于 2016-1-12 11:48
你的3d是软件自己生产的吗,自己添加3d库了吗

部分是自己用SW、proe画的,部分是从网站下载的3d封装

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 楼主| 发表于 2016-1-12 19:08:21 | 显示全部楼层
gnocy 发表于 2016-1-12 08:34
板子的分层是,top(信号)- 内电层- 信号 - 地层。这样分层好像不太好吧,请教一下,看过好像电源层都放在 ...

是的,一般电源层是放在中间两层。。考虑到我这个板子fpga256个引脚,要全部拉出来,而且我这个板子是5*7cm的,面积有点挤,底层也放了好多元器件,再加上底层有好多电容,所以底层不太方便拉IO线了。我参考黑金的FPGA开发板,也是这样分层设计的
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