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有谁用FPGA做过CPU吗?

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出0入0汤圆

发表于 2015-8-17 11:50:51 | 显示全部楼层 |阅读模式
最近在琢磨自己动手写一个CPU,不知CPU的内核主要难在哪里啊,有谁做过这方面吗?

阿莫论坛20周年了!感谢大家的支持与爱护!!

知道什么是神吗?其实神本来也是人,只不过神做了人做不到的事情 所以才成了神。 (头文字D, 杜汶泽)

出0入98汤圆

发表于 2015-8-17 11:57:53 | 显示全部楼层
以前在cnbeta看评论 很多CS或者EE专业的学生有一年的课程设计就是用FPGA做个CPU

出0入0汤圆

发表于 2015-8-17 12:01:53 | 显示全部楼层
就是状态机啊,不难。

出0入98汤圆

发表于 2015-8-17 12:01:55 | 显示全部楼层
以前在cnbeta看评论 很多CS或者EE专业的学生有一年的课程设计就是用FPGA做个CPU

出0入0汤圆

发表于 2015-8-17 12:15:16 | 显示全部楼层
真是一个卵疼的娃,有很多有意思的设计,比CPU好玩多了,看这个 康奈尔大学ECE5760课程
http://people.ece.cornell.edu/land/courses/ece5760/FinalProjects/

这是番墙工具,10块钱很好用
http://honx.in/_VNDR1s6vDxJ0rHVR

出0入0汤圆

发表于 2015-8-17 12:45:59 | 显示全部楼层
RAMILE 发表于 2015-8-17 12:15
真是一个卵疼的娃,有很多有意思的设计,比CPU好玩多了,看这个 康奈尔大学ECE5760课程
http://people.ece. ...

挺好玩的,,,

出0入0汤圆

发表于 2015-8-17 12:46:18 | 显示全部楼层
简单的CPU倒是不难,就是看你想搞到啥程度了。成熟的软核有一堆,可以参考一下。

出0入0汤圆

发表于 2015-8-17 12:48:17 | 显示全部楼层
大家都喜欢搞CPU,嘿嘿嘿嘿嘿。。。。

出0入0汤圆

发表于 2015-8-17 12:51:47 | 显示全部楼层
可以参考这个啊  http://www.amobbs.com/thread-5592456-1-1.html  《自己动手写CPU》

出0入0汤圆

发表于 2015-8-17 19:42:41 | 显示全部楼层
就是这个要根据你自己的要求呢,看你是要做复杂的还是要做一个简单的。前段时间做了个简单的,还不错

出0入22汤圆

发表于 2015-8-17 21:06:11 来自手机 | 显示全部楼层
nios不是属于cpu么?

出0入0汤圆

发表于 2015-10-8 11:53:58 | 显示全部楼层
FPGA做CPU体力活

出0入0汤圆

发表于 2015-10-8 12:25:06 | 显示全部楼层
想玩FPGA,却又不知道该干些啥,主要还是要能为以后工作什么的打下基础,做CPU耗时又不讨好

出0入8汤圆

发表于 2015-10-8 12:37:58 来自手机 | 显示全部楼层
qingyin2009 发表于 2015-10-8 12:25
想玩FPGA,却又不知道该干些啥,主要还是要能为以后工作什么的打下基础,做CPU耗时又不讨好 ...

做变频器吧

出0入71汤圆

发表于 2015-10-8 13:59:50 来自手机 | 显示全部楼层
用mips上吧的,很锻炼人的,上次看到同济大学有本科和研究生在做这方面的作业

出0入0汤圆

发表于 2015-11-16 21:41:12 | 显示全部楼层
这要看你写那种的?

出0入0汤圆

发表于 2015-11-22 22:09:49 来自手机 | 显示全部楼层
验证cpu还是得在fpga上跑

出0入17汤圆

发表于 2015-11-24 12:11:21 | 显示全部楼层
dellric 发表于 2015-10-8 13:59
用mips上吧的,很锻炼人的,上次看到同济大学有本科和研究生在做这方面的作业 ...

加州大学伯克利有一个64位CPU开源项目RSIC-V,6级流水线,带MMU和FPU,有完整的工具链,支持Linux和QEMU,跟Cortex-A5对比如下:
ISA/Implementation                ARM Cortex-A5                RISC-V Rocket                R/A
ISA Register Width                32 bits                        64 bits                        2
Frequency                                >1 GHz                        >1 GHz                        1
Dhrystone Performance        1.57 DMIPS/MHz                1.72 DMIPS/MHz                1.1
Area excluding caches                0.27 mm2                        0.14 mm2                        0.5
Area with 16KB caches                0.53 mm2                        0.39 mm2                        0.7
Area Efficiency                        2.96 DMIPS/MHz/mm2        4.41 DMIPS/MHz/mm2        1.5
Dynamic Power                        <0.08 mW/MHz                0.034 mW/MHz                >= 0.4

这个内核已经经过45nm投片测试的:
http://linuxgizmos.com/project-a ... -soc-and-dev-board/

另外还提供0/2/3/5级流水线的教育型内核Sodor。

UCB的EECS系是MIPS的发源地,里面有很多中国人,RISC-V团队里面也有的。

项目主页:
http://riscv.org/
代码:
https://github.com/ucb-bar/rocket-chip

更有意思的是git里面没有Verilog代码,Verilog代码是由工具产生的,方法如下:
http://riscv.org/download.html#tab_rocket

出0入0汤圆

发表于 2015-12-16 16:59:42 | 显示全部楼层
关注一下

出0入0汤圆

发表于 2015-12-16 22:53:20 | 显示全部楼层
希望有机会学习一下
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