时钟配置

cosxu · 发表于 2013-11-22 18:43:34

我的系统时钟是50Mhz，我想得到一个40Mhz的信号频率，请问应该怎么分频呢？
另外，我板子上的晶振是50M的，这就决定了我的外部时钟频率为50M是吧？那我的内部时钟怎么确定大小呢？

cmos2345 · 发表于 2013-11-22 19:34:07

50MHz÷5×4 = 40MHz

aammoo · 发表于 2013-11-22 19:35:44

pll

cosxu · 发表于 2013-11-24 13:47:21

aammoo 发表于 2013-11-22 19:35
pll

用pll 我是先将频率倍频到200M，再用类似DDS的分频方法将频率分到40M，但得到的频率波形不好，占空比不是50%，而且不是标准的矩形波，有点像三角波了，应该怎么解决呢

蓝色风暴@FPGA · 发表于 2013-11-24 19:27:51

你在PLL输出直接填40M不行吗

cosxu · 发表于 2013-11-25 19:45:59

蓝色风暴@FPGA 发表于 2013-11-24 19:27
你在PLL输出直接填40M不行吗

怎么用PLL直接填40M，求大神指教

yfclyy · 发表于 2013-11-25 20:02:06

quartus的话在tool->MegaWizard->create->IO->ALTPLL

cosxu · 发表于 2013-11-26 13:21:32

yfclyy 发表于 2013-11-25 20:02
quartus的话在tool->MegaWizard->create->IO->ALTPLL

我知道自己是个菜鸟，但这种基本操作还是会的，
我的外部晶振是50M的，在PLL里面设置clk0的时候是不是它已经固定为50M不能再改动了，这样的话怎么可以用PLL直接输出40M呢？

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