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为啥俺的DS1302一天要慢4S

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出0入10汤圆

发表于 2012-11-19 17:31:38 | 显示全部楼层 |阅读模式

电路图如上所示,测了下这个DS1302一天要慢4S,两条慢了8S,三天慢了11S,咋回事啊?

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知道什么是神吗?其实神本来也是人,只不过神做了人做不到的事情 所以才成了神。 (头文字D, 杜汶泽)

出0入0汤圆

发表于 2012-11-19 17:35:27 | 显示全部楼层
看看你的晶振频率对不对,再看看它会不会偶尔停振

出0入0汤圆

发表于 2012-11-19 17:40:34 | 显示全部楼层
换晶振再试一下

出0入0汤圆

发表于 2012-11-19 17:44:21 | 显示全部楼层
这个是通病,

出0入0汤圆

发表于 2012-11-19 18:43:59 来自手机 | 显示全部楼层
选3ppm晶振

出0入0汤圆

发表于 2012-11-19 19:56:11 | 显示全部楼层
给晶振穿个小棉袄  

出0入0汤圆

发表于 2012-11-19 20:15:43 | 显示全部楼层
找块坏主板看有没有晶振,拆个装上精度不错

出0入0汤圆

发表于 2012-11-19 20:28:57 | 显示全部楼层

图中CI,C2这两个电容就叫晶振的负载电容,分别接在晶振的两个脚上和对地的电容,一般在几十皮法。它会影响到晶振的谐振频率和输出幅度,一般订购晶振时候供货方会问你负载电容是多少。

常规的负载电容20pF,负载电容就是32pF比较匹配

晶振的负载电容公式=[(Cd*Cg)/(Cd+Cg)]+Cic+△C

式中Cd,Cg为分别接在晶振的两个脚上和对地的电容,Cic(集成电路内部电容)+△C(PCB上电容)经验值为3至5pf。因此,晶振的数据表中规定12pF的有效负载电容要求在每个引脚XIN 与 XOUT上具有22pF(2 * 12pF = 24pF = 22pF + 2pF 寄生电容)。两边电容为Cg,Cd,负载电容为Cl,   cl=cg*cd/(cg+cd)+a

就是说负载电容15pf的话,两边两个接27pf的差不多了,

各种逻辑芯片的晶振引脚可以等效为电容三点式振荡器。晶振引脚的内部通常是一个反相器, 或者是奇数个反相器串联。在晶振输出引脚 XO 和晶振输入引脚 XI 之间用一个电阻连接, 对于 CMOS 芯片通常是数 M 到数十M 欧之间. 很多芯片的引脚内部已经包含了这个电阻, 引脚外部就不用接了。这个电阻是为了使反相器在振荡初始时处于线性状态, 反相器就如同一个有很大增益的放大器, 以便于起振. 石英晶体也连接在晶振引脚的输入和输出之间, 等效为一个并联谐振回路, 振荡频率应该是石英晶体的并联谐振频率. 晶体旁边的两个电容接地, 实际上就是电容三点式电路的分压电容, 接地点就是分压点. 以接地点即分压点为参考点, 振荡引脚的输入和输出是反相的, 但从并联谐振回路即石英晶体两端来看, 形成一个正反馈以保证电路持续振荡. 在芯片设计时, 这两个电容就已经形成了, 一般是两个的容量相等, 容量大小依工艺和版图而不同, 但终归是比较小, 不一定适合很宽的频率范围. 外接时大约是数 PF 到数十 PF, 依频率和石英晶体的特性而定. 需要注意的是: 这两个电容串联的值是并联在谐振回路上的, 会影响振荡频率. 当两个电容量相等时, 反馈系数是 0.5, 一般是可以满足振荡条件的, 但如果不易起振或振荡不稳定可以减小输入端对地电容量, 而增加输出端的值以提高反馈量. . 一般芯片的 Data sheet 上会有说明。

另:

1.匹配电容-----负载电容是指晶振要正常震荡所需要的电容。一般外接电容,是为了使晶振两端的等效电容等于或接近负载电容。要求高的场合还要考虑ic输入端的对地电容。一般晶振两端所接电容是所要求的负载电容的两倍。这样并联起来就接近负载电容了。

2.负载电容是指在电路中跨接晶体两端的总的外界有效电容。他是一个测试条件,也是一个使用条件。应用时一般在给出负载电容值附近调整可以得到精确频率。此电容的大小主要影响负载谐振频率和等效负载谐振电阻。

3.一般情况下,增大负载电容会使振荡频率下降,而减小负载电容会使振荡频率升高

4.负载电容是指晶振的两条引线连接IC块内部及外部所有有效电容之和,可看作晶振片在电路中串接电容。负载频率不同决定振荡器的振荡频率不同。标称频率相同的晶振,负载电容不一定相同。因为石英晶体振荡器有两个谐振频率,一个是串联揩振晶振的低负载电容晶振:另一个为并联揩振晶振的高负载电容晶振。所以,标称频率相同的晶振互换时还必须要求负载电容一至,不能冒然互换,否则会造成电器工作不正常。

出0入4汤圆

发表于 2012-11-19 21:32:39 | 显示全部楼层
LS牛人                                

出10入113汤圆

发表于 2012-11-19 21:43:46 | 显示全部楼层
晶体两端加15pF电容,保你在1S内

出0入0汤圆

发表于 2012-11-19 21:59:10 | 显示全部楼层
饭桶 发表于 2012-11-19 21:43
晶体两端加15pF电容,保你在1S内

也不行吧,接15p的晶振、。

出0入0汤圆

发表于 2012-11-19 22:06:08 | 显示全部楼层
我的也是不准,实际看过那么多资料,主要就是晶振,找个好点的

出0入0汤圆

发表于 2012-11-19 22:58:08 | 显示全部楼层
晶振的事情 找不到好晶振 就在程序中做24小时误差校正把

出0入0汤圆

发表于 2012-11-19 23:11:11 | 显示全部楼层
呵呵,通病来的,我曾经试过用电脑主板的32768晶振与其谐振电容,结果照样慢。只有采用程序校正了。

出0入0汤圆

发表于 2012-11-20 07:52:13 | 显示全部楼层
不知加2个5pF负载电容会不会好些呢?

出0入10汤圆

 楼主| 发表于 2012-11-20 08:22:25 | 显示全部楼层
yunhuisong 发表于 2012-11-19 17:35
看看你的晶振频率对不对,再看看它会不会偶尔停振

晶振32.768KHZ的啊,怎么看停不停振?

出0入10汤圆

 楼主| 发表于 2012-11-20 08:23:00 | 显示全部楼层
dingshidong214 发表于 2012-11-19 19:56
给晶振穿个小棉袄

穿什么样的棉袄啊?

出0入10汤圆

 楼主| 发表于 2012-11-20 08:27:27 | 显示全部楼层
gentlerain 发表于 2012-11-19 20:28
图中CI,C2这两个电容就叫晶振的负载电容,分别接在晶振的两个脚上和对地的电容,一般在几十皮法。它会影响 ...

好牛叉哎!

出20入186汤圆

发表于 2012-11-20 08:33:53 | 显示全部楼层
用稳温有源晶振 吧

出0入8汤圆

发表于 2012-11-20 08:38:33 | 显示全部楼层
这个跟DS1302  关系不大。  最简单的  软件修正了。

出0入0汤圆

发表于 2012-11-20 08:40:15 | 显示全部楼层
好文章,顶…………

出0入0汤圆

发表于 2012-11-20 08:45:03 | 显示全部楼层
我的不慢,就是偏快.经长期观察发现,单单电池供电就基本上准确,如果通上交流电源就会偏快了,一直百思不得其解.

出0入0汤圆

发表于 2012-11-20 08:48:02 | 显示全部楼层
1、晶振
2、负载电容
3、PCB走线
4、电源和电池供电的稳定性
5、1302质量


从这5个方面查,以前也用过,也测过误差。比你的要小不少。

出70入145汤圆

发表于 2012-11-20 08:59:53 | 显示全部楼层
gentlerain 发表于 2012-11-19 20:28
图中CI,C2这两个电容就叫晶振的负载电容,分别接在晶振的两个脚上和对地的电容,一般在几十皮法。它会影响 ...

晶振的负载电容公式=[(Cd*Cg)/(Cd+Cg)]+Cic+△C

式中Cd,Cg为分别接在晶振的两个脚上和对地的电容,Cic(集成电路内部电容)+△C(PCB上电容)经验值为3至5pf。因此,晶振的数据表中规定12pF的有效负载电容要求在每个引脚XIN 与 XOUT上具有22pF(2 * 12pF = 24pF = 22pF + 2pF 寄生电容)。两边电容为Cg,Cd,负载电容为Cl,   cl=cg*cd/(cg+cd)+a

就是说负载电容15pf的话,两边两个接27pf的差不多了,

疑问:当负载电容为12pF时,12=[(Cd*Cg)/(Cd+Cg)]+Cic+△C,Cic+△C取3到5时,(Cd*Cg)/(Cd+Cg)]为7到9,cd和cg相等时,取14到18。按寄生电容2pF计算,cd和cg取20pF。
当负载电容15时,10到12时,在20pF到24pf之间,取22pF相比27pF更合适啊。

出0入0汤圆

发表于 2012-11-20 09:14:37 | 显示全部楼层
4S/3600S/24 = 46.3ppm

LZ核对下你的晶振等级,然后看是否电容用的不合适

出0入0汤圆

发表于 2012-11-20 09:21:09 来自手机 | 显示全部楼层
建议减少两端电容到10p就会快点。最好办法是换高精密晶振及电容。和1302没关系。
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