关于cd4066疑问，有图有真相

lidakemaki · 发表于 2012-8-9 22:33:46

本帖最后由 lidakemaki 于 2012-8-10 11:19 编辑

大家好：
我想请教一个问题，我现在的项目是用LM339+CD4066组合的一个电路。
用若干CD4066分时导通，CD4066一端连接被检测端，相应的另一端连接LM339。
LM339的待比较端与好几个CD4066的另一端相连（不是检测端）。
使用一个LM339一直比较。做到用一个LM339比较很多的待比较端。（这就意味着若干个CD4066的被导通端是需要连在一起的）
但是今天我用示波器发现，当我第一组CD4066导通时，LM339经过比较后，当该组CD4066被关闭时（即此CD4066各个端口不导通了，为高阻时），我发现与339相连的那一端，却保持了关断此CD4066前的电平状态，直到下一组CD4066被选中，各个端口导通后，电平才被拉下去，这是为什么啊？
补充说明，做此实验是，我把第一组的CD4066的一个被检测端给拉高了，第二组的是拉低的。我想问的是，当第一组CD4066被关闭时，而第二组CD4066也没有打开时（没有导通时），为什么被高阻的CD4066那端会保持之前导通时的电平呢？图11和22为示波器测得电平图，33和44为简易电路原理图。

i55x · 发表于 2012-8-9 22:55:05

没原理图？？？？？？？

lidakemaki · 发表于 2012-8-9 23:17:10

i55x 发表于 2012-8-9 22:55
没原理图？？？？？？？

原理图已经奉上，欢迎回答。

lidakemaki · 发表于 2012-8-10 09:31:51

顶一下，有点沉。

lidakemaki · 发表于 2012-8-10 13:26:17

顶一下，有没有高手回复一下

lidakemaki · 发表于 2012-8-10 21:04:01

关于cd4066疑问，有图有真相

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