大家用得是vhdl还是 Verilog编写的程序啊？

517650971 · 发表于 2011-8-5 18:14:09

90999 · 发表于 2011-8-5 18:16:33

Verilog

WaterToSea · 发表于 2011-8-5 19:39:23

Verilog

ssaweee · 发表于 2011-8-5 19:49:07

Verilog

diyer_zhou · 发表于 2011-8-5 20:01:46

Verilog 很久不用，现在忘了

j-link · 发表于 2011-8-5 20:37:17

2个一起上,再加AHDL....弄死交接人员.

02013063 · 发表于 2011-8-5 22:37:55

VHDL

eworker · 发表于 2011-8-5 23:04:08

回复【5楼】j-link
2个一起上,再加ahdl....弄死交接人员.
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motion_ctrl · 发表于 2011-8-5 23:07:10

VHDL

smare · 发表于 2011-8-5 23:17:18

在学样里学VHDL 的多。但在外面公司里用Verilog HDL的多。建义楼主搞Verilog HDL

pcbddd · 发表于 2011-8-5 23:39:51

VHDL更稳定，一般小公司用verilog，大公司用VHDL，个人觉得VHDL非常值得去搞，当然喽，如果两个都会就更好嘛，同意我的举下手手~~呵呵

517650971 · 发表于 2011-8-6 10:33:30

谢谢啦^_^

NJ8888 · 发表于 2011-8-6 12:10:44

VHDL，如果我以后选助手，只要VHDL的，呵呵

avrgogo · 发表于 2011-8-6 12:22:46

只会Verilog 的

40130064 · 发表于 2011-8-6 12:26:42

回复【9楼】eworker
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经常 VHDL 和 C 有时敲着敲着就混了
害别人，害自己吧！哈~~

VHDL好啊，写出来好读，还不用分大小写。一阵乱敲。

gymdove · 发表于 2011-8-6 12:34:06

都可以吧。把可综合的概念分清楚，用VHDL或是Verilog描述都一样。

现在的工具也基本都支持Verilog和VHDL混合仿真。

两种语言在可综合的部分在网表(NetList)层次上就能统一到一起。

PS：VHDL和Verilog描述的都是硬件的行为，这不是程序的概念。

517650971 · 发表于 2011-8-6 15:23:10

回复【15楼】888888888888
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为啥。。。

NJ8888 · 发表于 2011-8-6 15:25:56

回复【19楼】517650971
回复【15楼】888888888888
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为啥。。。
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好交流呗，以我为主，不能找个不懂VHDL的让我看Verilog

517650971 · 发表于 2011-8-6 18:56:46

回复【20楼】888888888888
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=_=你太残忍了

aystliu · 发表于 2011-8-6 18:57:05

Verilog 很主流吧，VHDL注意些结构能看懂大概就可以了，感觉还是Verilog编起来顺手一点，跟C像

ShuJi187 · 发表于 2011-8-6 20:22:10

vhdl

weixintec · 发表于 2011-8-6 21:37:19

你要是还没有开始学vhdl verilog这两个中的任何一个，那就强烈建议你学verilog。

dabing0 · 发表于 2011-8-6 21:51:41

我也verilog

volevole · 发表于 2011-8-8 01:27:12

VHDL，用一种能实现自己的设计思想，不贪多

tlong_1919 · 发表于 2011-8-9 17:42:40

VHDL

y595906642 · 发表于 2011-8-9 17:47:51

VHDL和C敲混是很经常的，还查不出错来，泪奔...

nasphere · 发表于 2011-8-10 13:51:13

好像大部分工程师都是用verilog的
我是用VHDL的我们学校开的相关课程也都是用VHDL

大家用得是vhdl还是 Verilog编写的程序啊？

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