问下大侠。怎么比较容易看懂别人的程序；VREILOG

li0o0o0o0o0o · 发表于 2010-8-4 16:13:14

学了一个来月，发现看别人程序时，那是相当痛苦啊

akuei2 · 发表于 2010-8-4 17:23:09

那是verilog HDL的却点 ..... 节哀呀！
楼主要更努力

tear086 · 发表于 2010-8-4 17:43:49

回复【楼主位】li0o0o0o0o0o
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自己改写一遍，再长的代码也理解了大概。统一风格后，再调试优化，归档供今后复用。

li0o0o0o0o0o · 发表于 2010-8-4 18:51:20

问题是我不知道从哪着手啊。有那个多个ALWAYS

akuei2 · 发表于 2010-8-4 20:56:01

回楼上 ...............................

楼主应该从更多简单的代码先入手先~
复杂的东西，往后自然会明白。

这是我学习的方式 ....仅供参考

恩补上！
楼上的楼上是砖家！金牙！听他的准没错！

li0o0o0o0o0o · 发表于 2010-8-4 21:41:55

回复【4楼】akuei2 回家阿贵猪
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回复【3楼】li0o0o0o0o0o
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改写的前提是看懂个大概吧。问题的关键是拿来一个程序，只是几个INPUT OUTPUT有标意思。其它一大堆REG 都不知道是什么。几个ALWAYS 也不知道出哪个入手。

tear086 · 发表于 2010-8-4 23:09:57

回复【5楼】li0o0o0o0o0o
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将各always块分开，最好一个always块只操作一个reg信号；
不需要将所有信号都在管脚声明后声明，在相应always块旁边声明即可；
能分成子模块的尽量分为子模块；
尽量采用寄存器输出；
不断调试子模块，直到没有错误，且波形正确后，归档待复用；
尽量不在顶层模块做复杂的逻辑描述，最好只例化子模块；
自己命名的信号最好有规律，好区分；
需要经常修改的量，最好参数化声明；
适当补充一定说明文档；
……

最重要的手上要有hdl语法书和数电书，不懂就翻书。

还有quartus ii自带的模板非常出色；新建hdl，edit-insert template，就可以插入许多优秀的、经过优化的模板；鄙人就是啃模板过来的，私下感觉比动不动就**135例呀、200例呀好一万倍。此外，奥特拉官网有大量学习资源：代码、手册、视频、范例、参考设计；你可以通过我以前发的帖子找到。

zxl2431 · 发表于 2010-8-4 23:34:54

回复【6楼】tear086 .COM 缺氧
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我想问一下，怎么学modelsim仿真，有没有入门级的比较系统的讲一下的？

li0o0o0o0o0o · 发表于 2010-8-5 09:16:58

回复【6楼】tear086 .COM 缺氧
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给个网址吧，搜不到奥特拉

bone · 发表于 2010-8-5 09:36:39

debussy

seemrain · 发表于 2010-8-5 10:00:18

不懂设计者的思路，又没有注释的话基本是很难看懂的~~~

tear086 · 发表于 2010-8-5 10:35:38

回复【8楼】li0o0o0o0o0o
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大名小名荟萃
Altera：亚尔特拉、奥特拉
Xilinx：赛灵思、犀利克斯
Nios II：[nɪəs]、牛死、你敖死、NII、n2
Quartus II：QII、q2

我的帖子
整理一份Altera亚洲创新设计大赛的资料——大话FPGA，发过来；顺便传点其他资料
http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=3844461

Quartus II自带手把手视频教程的使用
http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=3872859

视频；转特权（吴厚航）的；深入浅出玩转FPGA视频学习课程；三十五讲；3GB左右
http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=4011276

华清远见FPGA入门视频教程 493MB
http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=3912366

。。。。。。

wanwzy · 发表于 2010-8-5 18:38:35

mark

barryyan2007 · 发表于 2010-8-6 12:04:07

MARK

D.lovers · 发表于 2010-8-6 22:56:12

mark

yuri99q · 发表于 2010-8-12 13:31:54

只能说，我看懂程序，自行遍却错误一大堆，罢了~！

问下大侠。怎么比较容易看懂别人的程序；VREILOG

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