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SDIO的时钟线是50MHz,需要对SDIO的走线做等长处理吗?

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出0入32汤圆

发表于 2021-12-19 15:53:31 | 显示全部楼层 |阅读模式
等长处理很麻烦,问问大家,是否有必要做。

阿莫论坛20周年了!感谢大家的支持与爱护!!

曾经有一段真挚的爱情摆在我的面前,我没有珍惜,现在想起来,还好我没有珍惜……

出0入442汤圆

发表于 2021-12-19 17:19:31 | 显示全部楼层
SDIO应尽量短,且如果CLK有FB管脚的话,要绕到芯片/SD卡座再绕回来。否则如果线过长,可能会造成建立时间不足,传输出错。通常情况下可以不用严格等长,只要对CLK做好隔离就行了。

出20入128汤圆

发表于 2021-12-19 17:35:36 | 显示全部楼层
之前本坛大神说过,133M内,没有严格要求吧,不要太离谱就好

出0入0汤圆

发表于 2021-12-19 19:30:30 来自手机 | 显示全部楼层
之前rgmii 没注意。layout时差了200多mil 一样跑千兆没问题

出10入0汤圆

发表于 2021-12-19 20:47:48 来自手机 | 显示全部楼层
50M,我觉得没必要

出0入0汤圆

发表于 2021-12-19 22:52:03 | 显示全部楼层
个人觉得没必要

出0入9汤圆

发表于 2021-12-19 23:11:51 | 显示全部楼层
Mecono 发表于 2021-12-19 19:30
之前rgmii 没注意。layout时差了200多mil 一样跑千兆没问题

rgmii,单独的一对差分线没达到1000M,它是4对线同时全双工250M x 4=1000M。

出0入4汤圆

发表于 2021-12-21 10:36:10 | 显示全部楼层
没必要.  只要没有离谱的绕圈线, 布通就行.

出0入59汤圆

发表于 2021-12-21 10:42:53 | 显示全部楼层
之前看到人家画板的板, RS485,   蛇形等长。。。。。   
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