基于FPGA的UART通信中的fifo问题

laokongzhuang · 发表于 2011-6-8 10:14:58

UART通信顶层程序 (原文件名:QQ截图未命名.png)
这是我的UART顶层程序，FPGA通过串口接收数据给ARM，ARM通过它发送数据。请问
1.ARM该什么时候给发送端的fifo写数据，又什么时候从接收端的fifo中读数据？这个时序怎么控制啊？
2.如果不用fifo做缓存，该用什么？寄存器吗？
谢谢！

hjjft · 发表于 2011-6-8 11:46:39

1.发送端的fifo非满即可往里面写数据，接收端fifo非空即可从里面读数据。当然，如果用超时的方式接收数据效率会更高些。可以用查询的方法查询fifo的空/满标志位，也可以用中断的方式。通常情况下，发送用查询方式，接收用中断方式（非空中断或超时中断）。
2.用寄存器也可以。但是资源允许的情况下，用fifo比较好，效率高些。

Jigsaw · 发表于 2011-6-8 11:47:33

FIFO需要一个flag

laokongzhuang · 发表于 2011-6-8 19:34:55

回复【1楼】hjjft
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(原文件名:lpm_fifo_transmitter_wave0.jpg)
这是fifo的时序图，里面有个时钟信号，读写使能信号如何与时钟同步啊？读写信号太短或太长可能会导致读写不到数据或读写了几遍数据。如果读写一直有效则要保证数据要随时钟及时变化，否则会读写几遍，这些都怎么控制啊？
谢谢！

xmjulytiger · 发表于 2011-6-8 21:58:21

干嘛不用spi?

hjjft · 发表于 2011-6-9 15:07:36

回复【3楼】laokongzhuang
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读写信号要与fifo的驱动时钟同步

laokongzhuang · 发表于 2011-6-10 12:29:38

回复【5楼】hjjft
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就是不明白如何做到同步啊，读写信号是ARM传过来的，时钟是FPGA内部提供的，这个同步应该比较麻烦吧？有没有简单的方法实现缓存呢？

hjjft · 发表于 2011-6-10 16:32:53

用fifo的驱动时钟对ARM的读写信号进行采样，然后生成同步的读写信号。

hjjft · 发表于 2011-6-10 16:34:16

如果有将ARM的读写时钟引入FPGA的话，可以直接使用该时钟来驱动fifo，就可以很方便地实现同步

laokongzhuang · 发表于 2011-6-28 10:53:54

回复【6楼】laokongzhuang
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请问读写信号的宽度如何和fifo的驱动时钟信号匹配？比如fifo驱动时钟周期200ns，那么读写信号的有效宽度就必须满足在第一个时钟沿时有效，在下一个时钟沿必须无效，否则就会读写两次数据，这个如何做到？谢谢！

NJ8888 · 发表于 2011-6-28 11:01:21

时钟信号频率至少8或16倍波特率时钟,也就是所谓一个未采样8或16次的单片机内部做法

xuzhengan123 · 发表于 2011-6-28 13:10:16

mark

chenbo_ourdev · 发表于 2012-5-6 09:08:45

感觉不太好弄!

chenweigang · 发表于 2012-9-3 22:17:21

楼主，FPGA的UART通信搞好了吗，可以发我一份做个参考吗？chenwg7@126.com

lidakemaki · 发表于 2013-8-10 10:36:08

laokongzhuang 发表于 2011-6-28 10:53
回复【6楼】laokongzhuang
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请 ...

这个问题你得到答案了吗？
我也有相应的问题。
是读取了二次还是一次呢？
是不是第一次读取或写入的时候没有完成，第二次不会被触发，不会执行？还是被默默挂起了，最后又执行了第二次？

wyatt · 发表于 2013-8-10 11:02:24

UART需要配置波特率,对模块的运行时钟根据波特率寄存器用个计数器做一个采样时钟即可

wyatt · 发表于 2013-8-10 11:03:20

UART用FIFO有点浪费资源了吧,UART16550还差不多...

基于FPGA的UART通信中的fifo问题

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