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使用原理图输入这种方法的人多吗?

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出0入0汤圆

发表于 2011-3-7 23:29:50 | 显示全部楼层 |阅读模式
我在论坛里看到都是用VHDL语言输入的,我使用的是EPM1270,全是用原理图输入,我感觉很直观,调试与仿真也特方便。是不是我是异类,用原理图输入的人特少,是不是也像PLC的论坛一样,论坛讲的都用STL输入,但实际梯形图使用的人更多。

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知道什么是神吗?其实神本来也是人,只不过神做了人做不到的事情 所以才成了神。 (头文字D, 杜汶泽)

出0入0汤圆

发表于 2011-3-7 23:34:25 | 显示全部楼层
大型的设计都是verilog

出0入0汤圆

发表于 2011-3-7 23:49:08 | 显示全部楼层
大型的设计都是VHDL.

出0入0汤圆

发表于 2011-3-7 23:49:44 | 显示全部楼层
楼主看看我的贴子 帮帮我了!

出0入0汤圆

发表于 2011-3-7 23:58:14 | 显示全部楼层
用原理图的话,如果你把芯片由xilinx换成altera或者反过来,全部图纸都白画了。

用语言的画,都可以。

还有,你用原理图,没法使用功能强大的第三方仿真软件,调试、仿真很不方便。

出0入0汤圆

发表于 2011-3-8 00:02:21 | 显示全部楼层
我是刚接触的时候用原理图入门,后来就学习verilog了。
我觉得纯用原理图输入的,很牛。

出0入0汤圆

 楼主| 发表于 2011-3-8 00:05:14 | 显示全部楼层
回复【2楼】40130064 博德之门IV
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大型的设计也是由很多模块组成,原理图组成一个个小模块,再由一些小模块组成功能块,再由功能块组成大的功能块,直到顶层

出0入0汤圆

发表于 2011-3-8 09:26:33 | 显示全部楼层
简单的模块可以用原理图, 复杂的算法, 时序处理用原理图怎么实现?

一般顶层或模块顶层用原理图方式连接,其他的算法还要是用VHDL或verilog写吧!

相互结合才强大!

出0入0汤圆

发表于 2011-3-8 09:59:09 | 显示全部楼层
呵呵,能实现目的就OK。

出0入0汤圆

发表于 2011-3-8 12:09:03 | 显示全部楼层
我顶层用原理图,感觉连线直观,另外ISE综合能把原理图换成MAP的VHD代码

出0入0汤圆

 楼主| 发表于 2011-3-9 08:46:12 | 显示全部楼层
回复【7楼】cicnx
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我的时序也是用原理图完成,像RS232通讯、RAM的读写全部用原理图实现,在Quartus II软件中,它的宏很多,用起来很方便,只需拖过来略加设置就可以了,如果需要移植,可以把原理图转换为VHD代码,有谁知道怎么才能把VHD代码转换为原理图,我看VHD代码很费劲,看电路原理图很直观。
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