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帮忙看下如何快速实现灰阶图像转Jpg格式。 chun2495 2018-11-14 52356 chun2495 2018-11-15 16:23
找人辅导Verilog Eworm001 2018-11-10 284159 Eworm001 2018-11-13 15:38
开源 自编 verilog 的 SPI协议 attachment selme 2018-8-29 114091 wowangru 2018-11-12 17:42
Verilog 梯形,S形加减速程序测试工程 attachment 40130064 2013-7-3 135347 wowangru 2018-11-9 20:46
请教USB Blaster 在Win 10下兼容性的问题 attachment chunri 2015-10-1 43875 huangqi412 2018-11-9 14:38
FPGA FFTip核作fft运算时输出的疑问? attach_img lpandadp 2018-11-9 01560 lpandadp 2018-11-9 11:47
DDS生成正弦序列送DAC,应该用有符号还是无符号数 attach_img gongcsf 2018-11-3 114106 gongcsf 2018-11-7 12:10
spi传输距离10m 最多可以接几个从设备 csq1997 2014-2-27 199538 jianfengxixi 2018-11-5 16:10
EP3C5E144C8+FT232H+AL440B轻松搞定USB数据传输 attachment jr9910 2012-12-2 5110636 billy_jhgg 2018-11-5 09:25
cyclone ii的io管脚跑1mhz的方波抖动 attach_img XP85118978 2012-12-28 194508 wowangru 2018-11-4 19:33
阅读verilog的软件 givealittletime 2018-10-10 224880 wowangru 2018-11-4 19:16
timequest的多循环通路 是 多周期 约束的意思吗? attach_img atom100 2014-7-7 11728 wowangru 2018-11-4 17:47
altera的pll输出可以驱动多少寄存器? atom100 2014-7-7 22036 wowangru 2018-11-4 17:47
altera的多个时序约束文件*.sdc之间的关系? atom100 2014-7-7 23465 wowangru 2018-11-4 17:46
开源的Altera、Xilinx、Lattice三合一USB下载线★火爆、★炫耀、★讨论中! 精华 digest heatlevel  ...23456..7 cznlpy 2009-10-18 620190360 unnormal 2018-11-1 16:41
请帮忙在csdn上下载一下 SVA应用指南配套的光盘 attachment get500wan 2018-10-25 32038 bitcoin2 2018-10-27 16:34
请教VIVADO下DDS核的双通道,如何输入控制字 attach_img gongcsf 2018-10-22 01688 gongcsf 2018-10-22 12:40
CPLD移频键控(FSK),请教频率切换问题 attach_img liu672992381 2018-10-3 494431 liu672992381 2018-10-16 10:40
求助Nios II编译报错问题 attach_img 王晨 2018-10-10 32122 王晨 2018-10-11 11:22
关于CPLD应用问题 attach_img aglen_still 2018-10-8 143680 NJ8888 2018-10-9 19:28
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altera fpga管脚电平的问题 xycfwrj 2018-10-8 83149 xycfwrj 2018-10-8 17:49
找不到ALTERA的ep4ce6e22c8n芯片的IO说明,管脚分布,封装信息 attachment zzage 2018-10-5 115641 梁皇山土匪 2018-10-8 09:39
有没有用过国产fpga的谈谈经验 xycfwrj 2018-5-30 3914062 90999 2018-10-6 10:13
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CPLD新手请教几个问题,谢谢 aglen_still 2018-9-24 112619 zxq6 2018-9-27 10:05
单片机对EMP240连接的储存器读写错误太多,为什么? liudingding 2018-5-12 11979 htjgdw 2018-9-20 12:40
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Verilog写的一段简易CPU Sendzimir 2013-11-30 95110 huangqi412 2018-9-9 20:23
做了块Spartan-6,JTAG下载正常,烧写SPI Flash总失败 attach_img htjgdw 2018-8-23 146002 htjgdw 2018-8-28 16:06
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请教xilinx spartan 6 DDR3硬核MCB 是否免费的。 advantech 2018-8-17 42588 advantech 2018-8-19 11:22
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quartus分配管脚时,如何更改filter location中的内容 attach_img guo407214944 2018-3-13 26612 baoyin819 2018-3-16 20:42
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求教FPGA xilinx ARTIX-7 用内部block ram 时钟可以达到多块? ackyee 2018-3-2 96725 ackyee 2018-3-2 19:40
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