巫世杰 发表于 2013-10-30 21:25:45

quartus 13 版VHDL怎么仿真时序啊

我仿真时总出现那图片，而且我modelsim我装好了，怎么设置才能有用，我百度的都是一些VerilogHDL的

NEWT 发表于 2013-10-30 23:09:16

我用过，跟verilog没什么区别啊……
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