chenwh_amdz 发表于 2012-9-16 20:47:21

Verilog移位操作求解

Verilog中移位操作后变量的位宽怎么变的啊？
在书中看到2个示例：4‘b1010<<1 = 5'b10100,4'b1010>>1 = 4'b0101
为什么第一个位宽增加了，而第二个却不变呢？

moxiaoxiong 发表于 2012-9-16 23:04:26

有些东西可以先记住
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