shqila 发表于 2012-2-9 22:05:01

有人用过Altera的LVDS_TX模块，帮忙看个问题，谢谢

http://cache.amobbs.com/bbs_upload782111/files_51/ourdev_717218DRFV16.JPG
(原文件名:新建 BMP 图像.JPG)

如上图所示，请问为什么CoreClkFreq的是Outclk Freq的1/2呢，两者的频率不是应该一样吗？
用户手册上说tx_in上的数据要用CoreClkFreq寄存，这样算下来的话，输入数据速率就是输出数据速率的1/2了，搞不明白，求大侠解释

philoman 发表于 2012-2-10 09:19:15

难道因为LVDS是双线的，所以频率要加倍？




























呵呵，开个玩笑，楼主注意数据与时钟边沿的关系，有的是SDR，有的是DDR；另外，这个lvds_tx有点儿串化器(SerDes)的意思；
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