bingguji 发表于 2011-12-8 21:58:47

哪位仁兄能提供不依赖cs控制的spi通信 verilog代码实现啊！！

在使用stm32 spi库的时候 发现stm32的cs脚是可以做普通io口，和其他芯片spi通信时很正常，随想自己写写看，可是时序总是控制不好，数据位会落后等问题。。。 stm32做主模式，fpga做从模式。
哪位高手能提供下，小弟万分感激！！

daixizheng 发表于 2011-12-13 18:25:10

你把以前的SPI 的代码 里面关于 这个cs片选 直接 低有效 不就得了？？？
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