睿智FPGA开发板 原理图 实验例程 用户手册等资料下载 及其它FPGA资料 FPGA视频教
睿智FPGA开发板 原理图 实验例程 用户手册等资料下载 及其它FPGA资料下载欢迎下载学习
点击此处下载 ourdev_674782HGVKVE.pdf(文件大小:325K) (原文件名:核心板原理图.pdf)
点击此处下载 ourdev_674783CF0VVW.pdf(文件大小:343K) (原文件名:接口板原理图.pdf)
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点击此处下载 ourdev_674785TPRLY1.zip(文件大小:7.60M) (原文件名:开发板经典接口实验.zip)
点击此处下载 ourdev_674787ZD2430.pdf(文件大小:3.49M) (原文件名:睿智FPGA开发板用户手册1.0版本.pdf)
后面会不断更新,请大家关注
实验例程使用最新版Quartus II 11.0 软件,支持中文注释,挺好用。软件安装,破_解见此链接:
http://www.ourdev.cn/bbs/bbs_content.jsp?bbs_sn=4952799&bbs_page_no=1&search_mode=3&search_text=weixintec&bbs_id=9999 上传一个fpga视频,2011年讲的,里面讲了verilog语法,我个人认为还不错,好像还是夏宇闻老师讲的。大家抓紧下。
点击此处下载 ourdev_674920FIJ1TH.zip(文件大小:4.23M) (原文件名:01 硬件描述语言概述.zip)
点击此处下载 ourdev_674923EWB7WO.zip(文件大小:6.23M) (原文件名:02 Verilog HDL有什么用处.zip)
点击此处下载 ourdev_674926J6WYBT.zip(文件大小:10.17M) (原文件名:03 学习FPGA选择verilog还是vhdl.zip)
点击此处下载 ourdev_674936RQ8M46.zip(文件大小:2.46M) (原文件名:04 FPGA设计中如何避免冒险竞争.zip)
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传得比较慢,但肯定传完,大家可以mark下,方便下载
点击此处下载 ourdev_674967FDGYRV.zip(文件大小:29.24M) (原文件名:06 Verilog模块的编写和验证.zip)
点击此处下载 ourdev_674992NL5Z3S.zip(文件大小:42.32M) (原文件名:07 modelsim和quartus的使用.zip)
点击此处下载 ourdev_674993Q9P15M.zip(文件大小:18.50M) (原文件名:08 Verilog模块的基本构成要素.zip)
点击此处下载 ourdev_674995H835N5.zip(文件大小:9.64M) (原文件名:09 Verilog模块中的信号.zip)
点击此处下载 ourdev_674999A8LI06.zip(文件大小:6.25M) (原文件名:10 Verilog中reg和wire的不同点.zip)
点击此处下载 ourdev_675000S1PDKL.zip(文件大小:3.61M) (原文件名:11 Verilog中阻塞与非阻塞.zip)
点击此处下载 ourdev_675010HMBURL.zip(文件大小:20.38M) (原文件名:12 FPGA中数字系统的构成.zip)
点击此处下载 ourdev_675011W8QDEE.zip(文件大小:4.64M) (原文件名:13 Verilog中两种不同的赋值语句.zip)
点击此处下载 ourdev_675012GAOIF9.zip(文件大小:10.15M) (原文件名:14 FPGA设计中时序逻辑设计要点.zip)
点击此处下载 ourdev_675013HEA3NQ.zip(文件大小:11.73M) (原文件名:15 Verilog模块的种类和用途.zip)
点击此处下载 ourdev_675014KCJ8WQ.zip(文件大小:9.47M) (原文件名:16 为什么Verilog能支持大型设计.zip)
视频上传完毕 好东西. 收藏了. 谢谢 多谢,正在下载~研究研究:) 哎~是不是和周立功的代码有相似性:) 谢谢。需要来买个玩玩 mark! 以下为周立功出的verilog语法视频教程,我个人认为讲得有点枯燥,但也还可以做为参考,学习一下。
点击此处下载 ourdev_675027JM43SU.zip(文件大小:14.23M) (原文件名:Verilog(1-2).zip)
点击此处下载 ourdev_675028PB5OHM.zip(文件大小:15.76M) (原文件名:Verilog教程(3~4).zip)
点击此处下载 ourdev_675031TQKTA4.zip(文件大小:7.75M) (原文件名:Verilog教程(5).zip)
点击此处下载 ourdev_675067MXG2XV.zip(文件大小:17.98M) (原文件名:Verilog教程(6).zip)
点击此处下载 ourdev_675047PZFT0E.zip(文件大小:8.53M) (原文件名:Verilog教程(7).zip)
上传完毕 MARK 记号 MARK! mark!~ mark mark FPGA 顶 MARK 下载以后看了是不错。谢谢楼主。 mark mark! 不错 谢谢楼主提供的资料 MARK mark 谢谢,正需要。 mark mark mark 参与互动。 对楼主的工作支持,辛苦了 记号 慢慢学习! MARK mark 不搞FPGA了,友情帮顶一下 回复【35楼】ShawnLinson 昇
不搞fpga了,友情帮顶一下
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多谢多谢 学习FPGA很有必要. 多谢楼主分享! 很全的资料,多谢楼主分享 markFPGA资料 多谢 这是夏宇闻的verilog视频吧? 回复【1楼】weixintec 睿智
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顶一个! 再顶。 mark 多谢 mark,3q mark 之前学过点皮毛,现在不搞了,顶一下。 mark 顶下 果断马克,多谢楼主分享精神。 收藏! 先顶再下 强势mark!! MARK! 回复【楼主位】weixintec睿智
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楼主有没经过压缩的视频吗,上面字不清楚,看起来有点吃力。。。 mark一下 好资源 mark一下 谢谢共享!!!!1 很好,很强大,不过还是比较基础的 Thanks! MARK 好东西,谢谢分享,收藏了 很好! mark!!!! 很好 mark了。。 mark 下载不了啊 mark一下 很好很强大 mark mark Mark! 冬日暖阳,收了,谢了,楼主。 正在下载 晚上回家加班 谢LZ mark FPGA学习 郁闷啊,我们学的是VHDL,不过还是看看 mark 好东西. 收藏了. 谢谢 很不错啊 mark 收藏!正学CPLD呢 多谢 仔细研究一下 mark 好东西啊!!! MARK,,,,, 多谢楼主提供资料,感谢 mark 收下了 感谢楼主分享! mark mark 接口程序都是周立功实验箱的程序,怎么也不改改呀,哈哈!现在开发板程序都是抄呀抄!哎。。。。。。。。。。。。。 mark。。。。。。。。。。 多谢分享了, 很好,基础资料都有了 mark ~~~~~~~~!! 好{:lol:} 楼主辛苦了。
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