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liquanmin 发表于 2011-3-9 21:15:59

verilog spartan-3e驱动flash M25p16程序---求助

module spiflash3(Clk,Dout,Din,Ss,Hod,Wr,Sck);
input Clk,Din;
output Dout,Ss,Hod,Wr,Sck;
reg Ss,Sck,Dout,Wr,Hod;
reg Clk1=0;
reg Data=0;
integer i=1;
initial
   begin
           assign Wr=1;
                assign Hod=1;
                assign Ss=1;
                assign Sck=1;
                assign Dout=1;
        end
always @(posedge Clk)
   begin
           if(i<=5)
               i=i+1;
                else
               begin
               i=1;
               Clk1=~Clk1;
               end
        end
always @(posedge Clk1)
   begin
           Ss=0;
                Sck=0;Dout=0;Sck=1;//写使能
                     Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=1;Sck=1;
                Sck=0;Dout=1;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Ss=1;
                //写数据指令
                Ss=0;
                Sck=0;Dout=0;Sck=1;
                     Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=1;Sck=1;
                Sck=0;Dout=0;Sck=1;
                //写地址0100000；
                Sck=0;Dout=0;Sck=1;
                     Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=1;Sck=1;
                Sck=0;Dout=0;Sck=1;
                      Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                     Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                //写数据01h
                Sck=0;Dout=0;Sck=1;
                     Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=0;Sck=1;
                Sck=0;Dout=1;Sck=1;
                Ss=1;               
   end
endmodule
综合时出错如下：FATAL_ERROR:Xst:Portability/export/Port_Main.h:143:1.17 - This application has discovered an exceptional condition from which it cannot recover.Process will terminate. For technical support on this issue, please open a WebCase with this project attached at http://www.xilinx.com/support.
请高手指教。。。。

suxilong 发表于 2013-2-18 15:39:20

什么来的 这么乱？？？

zhangyunbo 发表于 2013-3-4 14:55:19

有点乱额。。。

nnimo 发表于 2013-3-4 15:58:24

哥看得眼花。。。

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