liuxiaorui 发表于 2010-12-22 21:43:46

请问下，我的project烧到FPGA上后，为什么输出管脚无法显示？做毕设，急！v5的板子

如题，谢谢各位：）

a_King 发表于 2010-12-25 09:15:41

管脚分配的对不？引脚定义的对不？
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