VERILOG问题求助
请问各位DX,如何实现以下功能mcu_data_temp<=r_data_temp[ ((cpld_in_add<<3))+7:(cpld_in_add<<3) ];
这样写 铁定不通过 回复【楼主位】unicontrol
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assign mcu_data_temp = r_data_temp[((cpld_in_add<<3) + 7):(cpld_in_add<<3)];
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